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RISC-V: probes: Treat the instruction stream as host-endian
authorPalmer Dabbelt <palmerdabbelt@google.com>
Sat, 23 Jan 2021 03:34:29 +0000 (19:34 -0800)
committerPalmer Dabbelt <palmerdabbelt@google.com>
Fri, 19 Feb 2021 07:18:02 +0000 (23:18 -0800)
Neither of these are actually correct: the instruction stream is defined
(for versions of the ISA manual newer than 2.2) as a stream of 16-bit
little-endian parcels, which is different than just being little-endian.
In theory we should represent this as a type, but we don't have any
concrete plans for the big endian stuff so it doesn't seem worth the
time -- we've got variants of this all over the place.

Instead I'm just dropping the unnecessary type conversion, which is a
NOP on LE systems but causes an sparse error as the types are all mixed
up.

Reported-by: kernel test robot <lkp@intel.com>
Signed-off-by: Palmer Dabbelt <palmerdabbelt@google.com>
Acked-by: Guo Ren <guoren@kernel.org>
Signed-off-by: Palmer Dabbelt <palmerdabbelt@google.com>
arch/riscv/kernel/probes/decode-insn.c
arch/riscv/kernel/probes/kprobes.c

index 0876c30..0ed043a 100644 (file)
@@ -16,7 +16,7 @@
 enum probe_insn __kprobes
 riscv_probe_decode_insn(probe_opcode_t *addr, struct arch_probe_insn *api)
 {
-       probe_opcode_t insn = le32_to_cpu(*addr);
+       probe_opcode_t insn = *addr;
 
        /*
         * Reject instructions list:
index e60893b..a2ec186 100644 (file)
@@ -57,7 +57,7 @@ int __kprobes arch_prepare_kprobe(struct kprobe *p)
        }
 
        /* copy instruction */
-       p->opcode = le32_to_cpu(*p->addr);
+       p->opcode = *p->addr;
 
        /* decode instruction */
        switch (riscv_probe_decode_insn(p->addr, &p->ainsn.api)) {